Allegro如何快速上手？新手PCB布局避坑指南

经过本人员实地测试Allegro 17.4版本, 遭遇过在进行布局期间元件飞线呈现混乱不堪状态, 到了后期对板子进行修改时陷入毫无头绪、不知从何处着手的情况, 这种状况类似于挖到难以跳出的坑。对于新手而言, 只要依照步骤逐一逐步实施操作, 便能够较为轻易地绕开此类在实际操作中很常见就会遇到的问题之处。

第一步 设置栅格与原点

进入Allegro主界面后，先别急着摆元件。点击菜单栏中的 Setup 选项, 接着选择 Grids, 之后在弹出的窗口里面, 把 Non-Etch 的 X、Y Spacing 统一设置成 5.0 mil, 并且把 All Etch 的 X、Y Spacing 也统一设置成 5.0 mil。随后, 点击 Setup , 接着点击 Change Drawing Origin, 随后, 在命令窗口输入坐标 0 0, 之后, 将原点定在板框左下角。

新手避坑

有人直接就默认了25mil的栅格, 随后元件虽然对齐了, 然而飞线却歪歪扭扭, 到了后期走线的时候根本就拉不直。出现了报错现象, 元件常常吸附不到理想的位置。其核心原因在于这个栅格设置得太大了。有一个快速解决的办法, 改成5mil之后, 按住那个Ctrl, 再加上鼠标左键进行拖动, 这样就能够实现微调了。

第二步 固定结构元件与接口

先放置连接器、螺丝孔等结构件, 选择 Place, 再选择 Manually, 在 Placement List 中勾选 Package Symbols, 寻找连接器封装, 比如 USB_CON, 双击后放进板框。跟着运用 Move 命令, 通过右键挑选 Snap Pick to → Pin那个操作, 将其对准结构定位孔。在这个时候, 关键参数拥有的最优推荐值呈现为这样的情况: 相对原点偏移量被控制在±5mil范围的值内里, 通过这种方式能够使得后续装配不会产生偏位现象。

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有不少新手是直接通过手动进行拖放操作的, 这就致使连接器发生了歪斜, 歪斜的程度达到了0.3mm, 到了后期结构装配时顶死了外壳, 出现的报错现象是, 在3D视图之下连接器和外壳开孔存在错位情况。快速得到解决的办法是: 运用 Setup 这种方式, 进入 Application Mode 这个模式, 再进入 Placement Edit 模式, 将元件选中的情况下, 于 Property 面板之中输入 X 100 Y 200 以此来进行精准定位。

第三步 按功能模块分组摆放

把原理图的网表导入进去之后, 按照功能区域进行拉框操作, 运用 Place → Quickplace, 勾选 Place by refdes, 把 R、C、IC 等等分别放进预设好的区域内。这儿给出两种实操方案作对比, 方案A, 也就是按网络分组, 运用Logic, 经由Part Logic按照信号流迅速排列, 适用于高速板, 然而前期得耗费时间去建立分组, 方案B, 即按元件类型分组, 把电阻放置在一堆, 将电容放置在一堆, 适用于低频率板, 效率高不过飞线交叉较多。一种取舍的逻辑情况是, 要是板子当中存在DDR或者RF电路的话, 那么要选择方案A , 要是只是那块简单电源板的话, 方案B会更省时。

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那次我依照方案B完成排列后, 察觉到12根飞线缠绕得如同蜘蛛网一般, DDR时钟线的长度超出了2英寸。高频全完出现报错现象, 该现象为布局结束之后运行Tools → Reports → Unconnected Pins Report环节之际, 显露Pin count mismatch。提供一站式解决流程顺序方面的指导: 首先, 将所有元件进行Delete操作, 之后, 返回至原理图, 对网络标号是否一致开展检查工作；接着, 实施Update Symbols操作, 随后, 重新运行Quickplace, 并且切换到方案A。

第四步 使用Room规则约束

轻点 Setup 之后轻点 Constraints 接着轻点 Spacing, 去新建出一个 Room 区域, 就好比是 ROOM_ANALOG 这样的, 然后进行框选模拟电路元件这一操作, 再右键点击 Assign to Room, 往里面填入 ROOM_ANALOG。接着, 于Constrain Manager里, 把那个Room的线宽间距设置成8mil/8mil, 而其余的区域则采用默认的5mil。

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竟忘了在未给Room命名的状况下就去点确定, 进而致使所有的信号线都采用了同一间距规则, 最终差分对阻抗直接瓦解了。所出现的报错现象为: 在执行Show Element操作之后, Room属性呈现出NULL的显示状态。

第五步 对齐与调整

拿 Edit → Align 这个命令来用, 先去点基准元件, 而后再去点其他元件, 如此一来系统就会自行将其对齐到同一个 X 轴或者 Y 轴之上。接着再借助 Edit → Spin 来旋转元件, 从而使得飞线变为最短的状态。最后运行 Tools → Database Check 来修复任何存在的引用错误。

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当中进行Align操作之际, 要是挑选了具备不同封装形式的元件, 比如说SOT-23以及0402, 若强行去进行对齐的话, 那么就会致使焊盘出现错位的情况。其报错所呈现出来的现象为: Pad-stack name not found。而其形成的核心原因在于: 不同封装有着不一样的高度。快点的解决途径是, 手动去进行Y坐标的细微调整, 或者借助Edit这种操作方式选择Change选项, 在统一进行封装之后再开展Align操作。

本方法不适用的场景为: 倘若属于多层盲埋孔板或者HDI板, 那以上步骤当中的栅格设置以及Room规则将会欠缺灵活性, 建议转而采用Constraint Manager的Region分层约束, 并且搭配Tool → PCB Router自动走线。